1756-IB32

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　SoC時代的經(jīng)濟正在推動驗證的革新。革新的關(guān)鍵特征是 SoC（片上系統(tǒng)）中的 “S”（系統(tǒng)）。雖然芯片已經(jīng)變得更加復(fù)雜，但是用“復(fù)雜”來描述這場驗證革新的關(guān)鍵驅(qū)動因素并不充分和準確。如今，芯片驗證已經(jīng)成為系統(tǒng)級驗證和確認，由此會產(chǎn)生各種影響。

　　更多、更大型的系統(tǒng)設(shè)計以及嵌入式軟件的重要性不斷提高，這意味著更多的公司需要進行硬件仿真，更多的設(shè)計團隊需要介入到從模塊級一直延續(xù)到系統(tǒng)級的工作。他們需要一個整體的軟件仿真到硬件仿真流程，以便能夠?qū)⑺麄冊谀K級已經(jīng)完成的艱苦工作帶入子系統(tǒng)和系統(tǒng)級并進行重復(fù)利用。這樣可以節(jié)省大量時間，并提高驗證的質(zhì)量和工作效率。例如，不必在每次將更多模塊和子系統(tǒng)結(jié)合在一起時都要編寫新的測試平臺。

　　要實現(xiàn)這一整體流程，在主機工作站和硬件加速器之間建立一個超高速的串行連接（稱為co-model協(xié)同建模通道）來傳輸數(shù)據(jù)包是非常關(guān)鍵的。在協(xié)同建模中，運行在工作站上的為高級軟件仿真驗證所創(chuàng)建的可復(fù)用測試平臺，通過transactor事務(wù)處理器連接到硬件仿真器，事務(wù)處理器和DUT一起都放在硬件加速器上。這些加速的事務(wù)處理器會將高級事務(wù)轉(zhuǎn)換為信號級激勵來驅(qū)動DUT，從而使硬件加速器能夠以軟件模擬器10，000倍的速度來實現(xiàn)驗證。提高這些速度所需的協(xié)同建模通道性能取決于快速的物理鏈接和高度優(yōu)化的軟件層;迄今為止，這僅適用于Veloce 平臺。

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